proteus示波器时间基准调整技巧：深度剖析参数配置-程序员充电站

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如何让Proteus示波器真正“看清”纳秒级开关瞬态？

你有没有试过：在Proteus里搭好一个SiC半桥，仿真跑起来后，打开示波器——V_SW波形看起来“差不多”，但死区时间测不准、米勒平台看不清、振铃频率估不出？调了半天Time Base，不是满屏噪点，就是波形卡顿不动，最后只能靠“猜”来验证驱动时序？

这不是你的问题。这是绝大多数人在第一次认真用Proteus做功率电子仿真时都会撞上的墙。

而破墙的关键，往往不在电路模型本身，而在那个被当作“默认设置”的虚拟示波器上——尤其是它的时间基准（Time Base）。

Time Base不是缩放旋钮，是仿真数据的“翻译官”

很多人把Time Base理解成“横轴放大倍数”：1 μs/div比10 μs/div看得更细，仅此而已。
但真相是：Time Base本质上是在告诉Proteus——“请从我的仿真缓存里，按什么节奏抽点、再怎么铺到屏幕上”。

Proteus不是实时采样设备。它的仿真引擎以固定步长（比如你设的Minimum Time Step = 1 ns）连续计算所有节点电压，并把结果存进一块2048点的环形缓存。示波器启动后，并不重新跑仿真，而是从这块缓存中“切片回放”。

所以当你把Time Base设为10 ns/div，屏幕宽10格 → 总窗口 = 100 ns → 示波器就要从缓存中均匀抽取100个点（假设线性插值），每个点代表约1 ns的真实仿真时刻。
但如果Minimum Time Step其实是5 ns，那缓存里根本没有1 ns精度的数据——你看到的所谓“10 ns/div”，其实是一堆重复或插值出来的假点。波形开始阶梯化，边沿变钝，高频分量直接消失。

这就是为什么手册里总强调一句：Time Base ≥ 10 × Minimum Time Step。
它不是建议，是硬门槛。低于这个值，你不是在“放大细节”，而是在“脑补细节”。

我自己踩过的最典型坑：仿真一个GaN HEMT的开通延迟，设Time Base = 5 ns/div，结果测出来t_d(on)波动±30%，反复检查MOSFET模型参数无果。最后发现Minimum Time Step只设了1 ns，但SPICE求解器实际收敛步长被限制在8 ns——缓存里压根没5 ns粒度的数据。改成Time Base = 100 ns/div（对应1 μs窗口），反而能稳定抓到真实的开通拐点。

所以别急着调小Time Base。先打开System → Set Animation Options，确认你的Minimum Time Step是否真的支撑你想看的尺度。宁可让窗口大一点、手动拖动光标定位，也别用虚假高分辨率欺骗自己。

触发不是“按一下开始”，是和仿真节奏的一场谈判

触发失败，在Proteus里常表现为：波形静止、基线乱跳、或者干脆黑屏显示“Insufficient Data”。这时候很多人第一反应是调触发电平、换边沿方向……但往往漏掉一个关键前提：触发动作本身，也要在仿真缓存里“找得到”。

Proteus的触发逻辑很朴素：它不会实时监听信号，而是等一次仿真帧更新后，回头扫描刚写入缓存的这一批点，逐个比对是否满足条件（比如CH_A > 2.0 V且前一点≤2.0 V）。如果这批点太稀疏（Time Base太快导致采样间隔过大），就可能直接跳过那个真实的上升沿。

举个实例：你在测一个48 kHz的I²S BCLK，想抓单周期波形。如果Time Base设成10 μs/div（全屏100 μs），那一个BCLK周期≈20.8 μs，刚好占2格出头——很好观察。
但如果你为了“更精细”设成1 μs/div（全屏10 μs），那一个周期要横跨两屏，触发点可能落在缓存边界之外，结果就是：Auto模式下基线来回晃，Normal模式下永远等不到触发。

更隐蔽的问题是Holdoff（触发抑制）。
在PWM调制、PFC交错并联这类含多阶谐波的场景中，一个周期内可能有十几个电平穿越点。如果不设Holdoff，示波器会每微秒都触发一次，画面疯狂刷新，根本没法读数。我在调一个三相Vienna整流器时，就因为忘了开Holdoff，看着CH_B电压波形像心电图一样抖动，折腾半小时才发现是每200 ns就触发一次——而我的开关周期是5 μs。

Proteus默认Holdoff是0，这点非常反直觉。建议养成习惯：只要不是纯方波/正弦波，第一次触发失败后，先拉到10 μs试试；还不行，就50 μs；多数电源类波形，100–500 μs的Holdoff足够稳住画面。

另外提醒一句：触发源不一定要选CH_A或CH_B。
Proteus允许你直接输入网络名，比如/DRV/HS_GATE、/CTRL/COMP_OUT。这在分析控制环路响应延迟时特别有用——你可以用误差放大器输出做触发，再看PWM如何跟随，彻底避开驱动路径引入的时序混淆。

DC耦合和AC耦合，选错一个，整个分析就偏航

通道耦合看似最简单，却是我见过最多“低级错误”的地方。

DC耦合 = 原样呈现，AC耦合 = 滤掉直流。听起来很清晰。但问题在于：滤掉的不只是你想要滤的，还有你没意识到它承载的关键信息。

最经典的翻车现场：测TL431的REF引脚电压，判断反馈环路是否正常。有人图省事用AC耦合——结果屏幕上一条直线在0 V附近轻微抖动，他得出结论：“反馈没起振，环路稳定”。
实际上，TL431 REF是精确的2.5 V，AC耦合把它全滤掉了，你看到的只是运放输入失调电压引起的微弱交流噪声。真正的2.5 V基准消失了，整个环路工作点判断完全失效。

另一个高频误区：测MOSFET的V_GS，用AC耦合看开关过程。
V_GS高电平是12 V，低电平是0 V，AC耦合后变成以0为中心的±6 V摆幅。乍看没问题。但注意：V_GS的开通阈值（V_th）通常在2–4 V之间，这个绝对值在AC耦合下彻底不可见。你无法判断驱动电压是否真能可靠越过阈值，也无法识别米勒平台起始点（即V_GS停在V_th附近的那段平坦区）。

所以我的硬性原则只有一条：
✅ 凡是涉及绝对电压值判据的测量（过压保护点、ADC参考、LDO输出、比较器翻转阈值），必须用DC耦合；
✅ 凡是分析纯交流扰动（纹波、噪声、EMI传导路径、音频信号失真），优先AC耦合，但务必确认Time Base足够慢，避免AC耦合电容充电过程干扰稳态观测（Proteus默认RC时间常数≈60 s，1 s/div以上才明显）。

顺便说一句：GND耦合别当成摆设。我在调试一个电流检测放大器时，CH_A测ISENSE+，CH_B测ISENSE−，两路差分输入。一开始波形毛刺很大，怎么滤都消不掉。后来切到GND耦合，发现CH_B通道本身就有近20 mV的直流偏移——原来是原理图里接反了一个电阻。GND模式瞬间暴露硬件设计缺陷。

真实项目中的Time Base配置心法

去年帮一家客户做车载OBC（车载充电机）的数字控制仿真，他们卡在一个问题上：实测死区时间是85 ns，Proteus仿真始终只能测出72±5 ns。反复核对IR2110模型、PCB寄生、MCU GPIO配置，一无所获。

我们坐下来，从示波器设置一层层剥：

第一步：确认Minimum Time Step = 0.5 ns（够用）；
第二步：把Time Base从默认的200 ns/div，逐步下调到50 ns/div → 死区区域终于撑满2格；
第三步：切换Trigger为Single模式，手动点击“Run until Trigger”，避免Normal模式下因缓存刷新导致的触发点漂移；
第四步：把CH_A和CH_B都切到DC耦合，关闭所有滤波（HF Reject / LF Reject）；
第五步：用光标A定在CH_A上升沿50%处，光标B定在CH_B下降沿50%处，读Δt = 84.3 ns。

误差从±5 ns压缩到±0.3 ns。

这个过程没有高深理论，全是配置细节的叠加效应。

所以我现在教新人，只讲三条铁律：

“3–5格法则”：你想测的特征时间（比如死区、传播延迟、振铃周期），让它在屏幕上占满3–5格。太少读不准，太多看不全。算下来Time Base ≈ t_feature/ 4 是个极好的起点；
“触发先行”原则：调Time Base之前，先确保Trigger能稳定点亮。Auto模式下基线不滚动，Normal模式下能稳定捕获，再往下调Time Base才有意义；
“耦合审计表”：每次连新通道前，默念一遍：这个信号的DC分量有没有物理意义？如果有，DC耦合；如果没有，且你只关心交流成分，再考虑AC。

如果你正在仿真一个基于STM32H7的200 kHz同步Buck，想准确抓取HS-FET的米勒平台持续时间（典型值25 ns），那么推荐这样配置：