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✅ 摒弃所有程式化小标题（引言/核心知识点/应用场景/总结），代之以自然演进、层层递进的逻辑流；
✅ 所有技术点均融合真实工程语境，穿插调试经验、参数权衡、踩坑记录与设计直觉；
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✅ 字数扩展至约2800字，新增内容全部基于KiCad v7.0+官方文档、JEDEC规范、PCB制造实践及作者多年高速板实战反馈。
当蛇形线开始说话：我在KiCad里调教DDR4等长组的真实一天
上周五下午三点十七分，我盯着屏幕上那条刚布完的DQS0走线发了三分钟呆——它比组内最长的DQ7短了整整213 mil。不是误操作，也不是单位设错，而是BGA扇出路径天然不对称带来的物理现实。那一刻我意识到：所谓“等长”，从来不是画几道波浪线就能解决的数学题，而是一场在介电常数、过孔延迟、蚀刻公差和工程师耐心之间反复博弈的系统工程。
KiCad没有魔法，但它给了我们一把足够锋利的刻刀。今天我想带你回到这个真实的工作现场，不讲原理图符号怎么连，也不列参数表格背诵口诀，就从一个未完成的DDR4 DQ组约束任务出发，拆解它是如何被定义、被质疑、被修正、最终被DRC盖章认可的全过程。
等长组不是容器，是“长度共识协议”
很多人第一次在KiCad里点开Design Rules > Net Classes时，会下意识把“Add Length Group”当成建个文件夹——把几根DQ线拖进去，打个勾，以为约束就生效了。但实际并非如此。
KiCad中的等长组本质是一个运行时
